兩路任意階數並行濾波的實現方法：
儘管是並行濾波，但是在本質上仍是卷積的過程,對於濾波階數n的濾波係數，濾波的係數為n+1,在兩路並行中，階數n應該是偶數，係數n+1是奇數；
y[n]=∑_(k=0)^(k=n-1)▒〖x(n-k)h(k)〗
y(2n)=x(2n)h(0)+x(2n-1)h(1)+x(2n-2)h(2)+⋯+x(2n-396)h(396)
y(2n+1)=x(2n+1)h(0)+x(2n)h(1)+⋯+x(2n-395)h(396)
最終的實現就是乘累加的過程，先對應相乘，再去相加
在乘的過程中，需要注意資料的快取問題，在進入396個係數之後才是正確的值，而對於兩路的並行，需要先用乙個buffer進行緩衝。
1 2 3 4 5 … 196 197 198 199
x(0) x(2) x(4) x(6) x(8) x x(390) x(392) x(394) x(396)
x(1) x(3) x(5) x(7) x(9) x x(391) x(393) x(395) x(397)
對於396需要的buffer為199，其次分為buffer1和buffer2，在乘的時候注意對應的輸入和濾波係數，對於乘的結果進行累加的話，採用多級兩兩相加的方式，對於非偶數的項數讓最後乙個係數和0相加，最終得到簡化的相加的結果。
基於FPGA的FIR抽取濾波器設計
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FIR濾波器與IIR濾波器
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FIR濾波器設計
fir濾波器的優越性 相位對應為嚴格的線性，不存在延遲失真，僅僅有固定的時間延遲 因為不存在穩定性問題，設計相對簡單 僅僅包括實數演算法，不涉及複數演算法，不須要遞推運算，長度為m，階數為m 1，計算值約為m 2。關於fir濾波器的幅頻特性和相頻特性。在人們不關心相位時，能夠讓幅頻特性常為正，原來為...