序列檢測器是在數字碼流中檢測特定序列，利用同步狀態機的方式可以較容易的實現。
比如設計乙個檢測序列為10010的檢測器。
st1：確定狀態機的狀態數亮；
st2：確定每個狀態下的變數的值；
st3：狀態之間切換的條件；
st4：觸發狀態機的條件；
module xulie(x,z,clk,rst);
input x,clk,rst;
output z;
wire z;
reg[2:0]state;
parameter idle = 3'd0;
parameter a = 3'd1;
parameter b = 3'd2;
parameter c = 3'd3;
parameter d = 3'd4;
parameter e = 3'd5;
parameter f = 3'd6;
parameter g = 3'd7;
assign z = (state==d && x==0) ?1:0;
always @(posedge clk or negedge rst)
begin
if (!rst)
begin
state <= idle;
endelse
ca***(state)
idle :if (x==1)
state <= a;
else state <= idle;
a: if (x==0)
state <= b;
else state <= a;
b : if (x==0)
state <= c;
else state <= f;
c : if(x==1)
state <= d;
else state <= g;
d : if(x==0)
state <= e;
序列檢測器
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Verilog序列檢測器 兩例
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FPGA入門實驗之邊沿檢測器與序列檢測器
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