工具命令語言（tcl–tool command language）是vivado®工具環境中整合的指令碼語言。tcl是半導體行業中用於應用程式程式設計介面的標準語言，並由synopsys®設計約束（sdc）使用。
sdc是用於傳達synopsys synplify和其他**商的fpga綜合工具的時序約束的機制，並且是時序約束行業標準；因此，tcl基礎結構是指令碼語言的「最佳實踐」。
除了執行自動指令碼之外，tcl還使您可以對設計工具執行互動式查詢。tcl能夠以互動方式「詢問」設計資料庫的問題，尤其是圍繞工具和設計設定及狀態的問題。示例包括：查詢特定的時序分析報告命令有效，應用增量約束並在執行後立即執行查詢以驗證預期行為，而無需重新執行任何工具步驟。
2 non-project mode tcl script example
non-project mode 包含以下6步：
1）建立檔案輸出資料夾
2）讀取資源（verilog ip vhdl）和約束（xdc）
3）綜合
4）實現
5）產生bit流
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