用處 通常情況下，l2 cache被core 0，core 1共享。
core 0的記憶體訪問操作可能會清除core 1所使用的l2快取內容，從而使core 1的軟體效能有不確定性。
有時，我們需要為core 0 或core 1提供更多的確定性行為。
尤其是架構為amp時。
l2 cache劃分可以滿足這種需求。
如圖 2.1、圖 2.2為smp與amp架構圖。
圖 2.1 smp架構圖
圖 2.2 amp架構圖
原理 通過暫存器的控制可以將l2 cache鎖定在不同core上。
這讓使用者可以將l2 cache的功能保留在特定的core上。
cache way是分割槽的寬度，zynq的l2 cache有8 cache ways。
l2 cache控制器只能被鎖定8個不同的方式。
如圖 3.1所示，在zynq 7000中，cortex-a9 mp核的64個axi被分為8個可以鎖定的組。
圖 3.1分組
配置具體暫存器說明參照xilinx 官方資料手冊ug585。
配置1：通常情況（l2 cache 被core 0和core 1共享）。
reg9_d_lockdown0 = 0x0；
reg9_1_lockdown0 = 0x0；
reg9_d_lockdown1 = 0x0；
reg9_1_lockdown1 = 0x0；
配置2:4-0-4方式，每個核用一半（core 0使用cache way【0..3】；core 1使用cache way【4..7】）。
reg9_d_lockdown0 = 0xfff0;
reg9_1_lockdown0 = 0xfff0;
reg9_d_lockdown1 = 0xff0f;
reg9_1_lockdown1 = 0xff0f;
配置3:2-4-2方式（core 0使用cache way【0..1】；core 1使用cache way【6..7】；兩個核共享cache way【2..5】）。
reg9_d_lockdown0 = 0xffc0;
reg9_1_lockdown0 = 0xffc0;
reg9_d_lockdown1 = 0xff03;
reg9_1_lockdown1 = 0xff03;
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