處理器的執行流水線通常分為5個階段，分別為：取指、解碼、訪存、執行和寫回。這裡的訪存指的是訪問暫存器。
假設每個階段只占用乙個時鐘週期，那麼這個5級流水線的處理器每個時鐘週期可以執行一條指令。如下圖，
如果前一條指令的目的暫存器是當前指令的源暫存器，如：
圖中，指令0的執行結果在寫回的同時，連同指令1的其他暫存器資料一同給到指令1的執行階段，而指令1不需要再去暫存器檔案中讀取指令0的目的暫存器所指向的資料。
我們再看另外一種情況：當執行不能夠乙個時鐘週期執行完成，而需要三個時鐘週期。如下圖，
此時，如果仍然是每個時鐘週期取一條新的指令來執行，那麼資料前送將無法實現。
為了讓資料前送仍然可行，一種做法是每三個時鐘週期取一條指令。如下圖，
但這時流水線的執行效率降低。
為了提高處理器的執行效率，我們需要想辦法填充那些空閒的時鐘週期。在simt處理器中，可以讓其他warp的指令來填充那些空閒的時鐘週期，以提公升處理器的執行效率。如下圖，
一文讀懂處理器流水線
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