2021屆匯頂提前批 FPGA工程師崗位面經

2021-10-08 14:48:30 字數 1482 閱讀 5290

面試在上週六上午九點,匯頂有三次面試,一面技術面,二面hr面,三面綜合面,都是在乙個上午面完的,面了一上午。

在進行**面試之前沒有通知,下午直接打**過來問方不方便面試,由於下午不太方便,所以把時間調整到了晚上。

**面試主要也是問的技術相關。

首先讓進行了自我介紹。然後讓簡單介紹自己的專案,主要的框架和結構都讓詳細的說明,然後主要就是面試官進行提問。

專案上的問題問的比較多,具體的不多說。

其他知識問到的有:

1、fifo的滿空訊號分別是在哪個時鐘域產生的。

2、專案中有沒有遇到什麼時序問題,怎麼解決的。

3、跨時鐘域怎麼處理,資料跨時鐘域以及單bit訊號的跨時鐘域。

4、差分訊號的優點以及如何處理(我專案中有涉及差分訊號)

5、同步復位和非同步復位的優缺點。

6、了不了解高速介面的相關協議等等,還有些有點想不起來了。

週六上午九點的技術面,二面一。太睏了,都沒怎麼睡清醒,能想起來的問題也不多。主要是問的簡歷上的問題,其他知識問幾乎沒怎麼問。

主要問了:

1、用的什麼板子,什麼**軟體。

2、uart用的多少波特率,時序。

3、時序怎麼約的,時序問題怎麼解決的。

4、系統中的取樣率,時鐘,頻寬。

5、有沒有用過fifo,怎麼用的。

6、怎麼測量訊號的質量的,用什麼測的,怎麼測的。

7、有沒有做過input delay或者output delay。

hr面問的問題和普遍問的問題一樣,無非家庭,薪資,學生工作,男女朋友關係,最有成就感的事情等等。

但是有乙個問題,有點難回答:fpga工程師和ic設計工程師的選擇,hr一直問我,這兩個崗位的關係,以及如何選擇,讓我談談自己的想法。

然後我就按照自己想法說了,ic設計可能會更具有前景一些,然後她就一直問,那為什麼要選擇fpga工程師,然後說著說著就變成了我的意願是數字ic的崗位現在卻來了fpga的崗位......

然後第三面的時候,面試官也說根據二面,我的想法是數字ic的卻來了fpga的崗位。。。。

其實我也沒想那麼多,本來提前批只有fpga的崗位沒有ic的崗位,就沒糾結直接投了,然後沒想到面試官一直問。。。。

果然hr面試的時候不能按照自己的內心想法說。

綜合面啥都問,感覺像是兩個大佬,技術和其他方面都聊,都問,專案方面也問的很多。

有幾個不一樣的問題:

1、談談中美關係。。。(太為難我了)

2、工作中的創新點,相比其他產品,特點,優勢。。。(又是乙個難回答的問題,因為幾乎無)

3、做fpga是老師選的還是興趣愛好(又是乙個靈魂拷問)

4、本專業的學習上興趣愛好在哪一方面(這這這,因為在學習上沒有興趣,我也直說了。。。hhh)

暫時也就只能記起來這麼多,當天下午還面了中興,沒想到中興面了乙個多小時。我覺得是面過的公司裡問的最細緻的(雖然目前我也就面了3家),有時間在整理一下

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