面試官上來就先讓自我介紹，在介紹的時候順便說了自己在研究生期間做過的比賽和專案。然後面試官就讓說了其中最熟悉的專案介紹一遍。還讓我把專案的框圖發給他（或者畫出來）。
因為專案中涉及到了mpu（瘋狂被問，但是不是自己做的，說的很差），但是好點的就是其他自己做的部分說的還行（能夠自圓其說）。然後就是問了專案的效能指標。
最後看我簡歷上寫了uart、iic、spi，問這些是自己實際工程中做過還是自己學的。我就說uart、spi是自己實際專案中用到的，大概就順便把自己的另乙個專案介紹了一下。問到我uart時候，我說可能會資料傳輸出錯，也有可能不會，所以就在fpga端對資料設計了幀格式（打包）。這個就看自己uart設計了。面試官就問，怎麼會出錯，為什麼會出錯。我說了下（以前看過，但是記不太清，大概說了，得補充下），然後就說我這個設計肯定不會出錯（面試官也說不會出錯），這個話題就不了了之了。然後就問靜態時序分析，問是時序違例怎麼處理（很基礎），另乙個 面試官問靜態時序分析的指標（？？？不懂這個指標的意思，就說不懂，就說自己覺得指標的意思應該就是頻率以及是否違例（當時還想說四種靜態時序分析的路徑，想想算了不胡說了））。然後問了低功耗設計（基礎），就大概說了下，他問是自己做過還是自己看過學習的，我說自己平時遇不到，就只是做了門控時鐘，順便講了下門控時鐘的構成以及和d觸發器組成的門控時鐘的區別。
最後面試官問vcs是在linux下？然後就是問專案中的資料**怎麼對比結果（當時就說，因為資料少，就肉眼看了，面試官都笑了）。問我還有什麼想問的，就老一套（如果有幸入職，自己不是科班做ic的，怎麼培養，然後說是入職三個月會有完整走一遍流程，從前端到後端）。還說了可能會在1到2天或者乙個禮拜會有結果，等hr通知。
未完待續…
結果是我涼了（莫名其妙），面試官讓我等2面，最後等來了hr的感謝信！！！！（今天是把後續補上）
廣聯發21屆提前批筆試
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21屆中興IC提前批面經
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