Makefile語法和使用示例

make命令格式

makefile中的變數

編寫多檔案程式設計的makefile

使用autotools生成包含多檔案的makefile

目標：依賴檔案列表

:命令列表

#define pi 3.14

#include

#include
"main.h"
intmain()

main:mian.c main.h 

gcc main.c -o main
clean:
rm main

[-f file]:make 預設工作目錄中尋找名為gunmakefile,makefile,makefile作為makefile輸入檔案，-f 可以指定其他名字的檔案作為makefile輸入檔案

[option] :

-v:顯示make工具的版本資訊

-w:在處理makefile之前和之後顯示工作路徑

-c dir:讀取makefile之前改變工作路徑至dir目錄

-n: 只列印執行的命令但不執行

-s:執行但不顯示執行命令

1、自定義變數

在makefile中定義的變數

make工具傳給makefile的變數

2、系統環境變數

make工具解析makefile之前，讀取環境變數並且設定為makefile的變數

3、預定義變數

這些變數具有特殊含義，可直接在makefile中使用

$@: 目標名

$*目標名中除含副檔名的部分，副檔名包括：s,s,c,c,cc,cp,cpp,o等

$<:>

$^:依賴列表檔案中除去重複檔案的部分

$+:依賴列表中所有的檔案

$?:依賴列表中比目標檔案新的檔案

1、用vim寫乙個簡單的hello.c

#include

2、在終端執行vim makefile命令，在makefile檔案中寫入以下內容

cc=gcc

exec=hello
cflags=-wall -g
obj=hello.o
$(exec):
$(obj)
$(cc)
$(obj)
-o $@
$(cflags)
$(obj)
:hello.c
$(cc)
-c $< -o $@
$(cflags)
clean:
rm *.c,$(
exec
),*.o

1、寫乙個hello.**件內容如下：

#include

#include

"hello.h"
intmain()

可以用變數對這兩個方法進行優化，這裡我偷懶就不做了。

makefile語法示例

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