signoff是ic設計中的乙個重要的概念，他指的是成功完成ic設計的所有檢查的乙個標誌。在asci設計中，有以下兩次sign-off。
1. 前**（功能**）
在設計的電路進入布局佈線前應檢查其功能是否符合設計要求，這一**驗證稱之為第一次sign-off。
2.後**（時序**）
設計經過布局佈線之後，使用eda工具進行寄生引數提取，形成精確的post-layout電路網表，對此網表做時序**，來檢查時序行為是否符合要求，這一過程稱之為第二次sign-off。之後就可以進入foundry流片生產了。
sign-off分析做的是否完整和完備對ic產品的質量是至關重要的，若在這個階段查詢到問題並加以修正要比在生產階段的花費要低廉很多，所以各個ic公司都非常重視這個過程，eda廠商也都有自己完整的用來做sign-off的工具集。
比 較合適的方式是將sign-off分析整合到ic設計的流程中，與主體的設計工作形成乙個迭代，以保證設計的質量。sign-off階段需要檢查的 check-list包含：時序、訊號完整性、功耗、ir降、電遷移、寄生引數提取、drc（設計規則檢查）、lvs（版圖與電路圖一致性檢查）、雜訊、 片上熱量分析等。這些專案的檢查分析，可以在乙個整合的環境中完成，如virtusos或customer designer。有些人把它稱為in-house sign-off。
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前端大雜燴之JS（三）
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