推挽輸出:可以輸出高,低電平,連線數字器件; 推挽結構一般是指兩個三極體分別受兩互補訊號的控制,總是在乙個三極體導通的時候另乙個截止。高低電平由ic的電源低定。
推挽電路是兩個引數相同的三極體或mosfet,以推挽方式存在於電路中,各負責正負半周的波形放大任務,電路工作時，兩隻對稱的功率開關管每次只有乙個導通，所以導通損耗小、效率高。輸出既可以向負載灌電流，也可以從負載抽取電流。推拉式輸出級既提高電路的負載能力，又提高開關速度。
詳細理解：
如圖所示，推挽放大器的輸出級有兩個「臂」（兩組放大元件），乙個「臂」的電流增加時，另乙個「臂」的電流則減小，二者的狀態輪流轉換。對負載而言，好像是乙個「臂」在推，乙個「臂」在拉，共同完成電流輸出任務。當輸出高電平時，也就是下級負載門輸入高電平時，輸出端的電流將是下級門從本級電源經vt3拉出。這樣一來，輸出高低電平時，vt3 一路和 vt5 一路將交替工作，從而減低了功耗，提高了每個管的承受能力。又由於不論走哪一路，管子導通電阻都很小，使rc常數很小，轉變速度很快。因此，推拉式輸出級既提高電路的負載能力，又提高開關速度。
開漏輸出:輸出端相當於三極體的集電極. 要得到高電平狀態需要上拉電阻才行. 適合於做電流型的驅動,其吸收電流的能力相對強(一般20ma以內).
開漏形式的電路有以下幾個特點：
1. 利用外部電路的驅動能力，減少ic內部的驅動。當ic內部mosfet導通時，驅動電流是從外部的vcc流經r pull-up ，mosfet到gnd。ic內部僅需很下的柵極驅動電流。
2. 一般來說，開漏是用來連線不同電平的器件，匹配電平用的，因為開漏引腳不連線外部的上拉電阻時，只能輸出低電平，如果需要同時具備輸出高電平的功能，則需要接上拉電阻，很好的乙個優點是通過改變上拉電源的電壓，便可以改變傳輸電平。比如加上上拉電阻就可以提供ttl/cmos電平輸出等。（上拉電阻的阻值決定了邏輯電平轉換的沿的速度 。阻值越大，速度越低功耗越小，所以負載電阻的選擇要兼顧功耗和速度。）
3. open-drain提供了靈活的輸出方式，但是也有其弱點，就是帶來上公升沿的延時。因為上公升沿是通過外接上拉無源電阻對負載充電，所以當電阻選擇小時延時就小，但功耗大；反之延時大功耗小。所以如果對延時有要求，則建議用下降沿輸出。
4. 可以將多個開漏輸出的pin，連線到一條線上。通過乙隻上拉電阻，在不增加任何器件的情況下，形成「與邏輯」關係。這也是i2c，smbus等匯流排判斷匯流排占用狀態的原理。補充：什麼是「線與」？：
在乙個結點(線)上, 連線乙個上拉電阻到電源 vcc 或 vdd 和 n 個 npn 或 nmos 電晶體的集電極 c 或漏極 d, 這些電晶體的發射極 e 或源極 s 都接到地線上, 只要有乙個電晶體飽和, 這個結點(線)就被拉到地線電平上. 因為這些電晶體的基極注入電流(npn)或柵極加上高電平(nmos),電晶體就會飽和, 所以這些基極或柵極對這個結點(線)的關係是或非 nor 邏輯. 如果這個結點後面加乙個反相器, 就是或 or 邏輯.
其實可以簡單的理解為：在所有引腳連在一起時，外接一上拉電阻，如果有乙個引腳輸出為邏輯0，相當於接地，與之併聯的迴路「相當於被一根導線短路」，所以外電路邏輯電平便為0，只有都為高電平時，與的結果才為邏輯1。
關於推挽輸出和開漏輸出，最後用一幅最簡單的圖形來概括：
該圖中左邊的便是推挽輸出模式，其中比較器輸出高電平時下面的pnp三極體截止，而上面npn三極體導通，輸出電平vs+；當比較器輸出低電平時則恰恰相反，pnp三極體導通，輸出和地相連，為低電平。右邊的則可以理解為開漏輸出形式，需要接上拉。
樹莓派（十三） 多PWM通過GPIO口引腳輸出
import rpi.gpio as gpio import time gpio.setmode gpio.bcm gpio.setup 18,gpio.out pwm led0 gpio.pwm 18,10 將gpio27引腳的頻率設定為5hz 乙個脈衝時間長度0.2s pwm led0.star...
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PWM輸出引腳重對映
pwm輸出初始化 arr 自動重灌值 psc 時鐘預分頻數 void pwm init u16 arr,u16 psc 此部分需手動修改io口設定 rcc apb1enr 1 1 tim3時鐘使能 rcc apb2enr 1 3 使能portb時鐘 rcc apb2enr 1 0 開啟輔助時鐘 af...