應朋友要求，需要des加解密
演算法的verilog源**。
網上搜了一下，很少（而且只有萬惡的www.pudn.com能下，我還沒有賬戶，在此鄙視一下這個**.....），而且都沒有模式選擇埠，也就是說只能加密，不能解密。
下了乙份看上去邏輯流程清楚一些的源**，研究了2天des演算法流程，再結合**，懂了個大概，開始動手自己改原始碼，加模組和埠，重新設計連線。
由於加密部分的原始碼用的純組合邏輯，為了偷懶也就按組合邏輯加的解密模組，沒用時序電路。
今天晚上上課回來終於改完了，寫了個小tb測試一下，還好···成功加解密。。
很高興··
但是估計這個寫法50mhz跑不上·····
算了，不管了。。等有時間再上板子看看吧。。
純紀念帖···
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