IIC匯流排硬體工作原理(待完善)

2022-05-04 22:45:11 字數 1088 閱讀 4246

一、iic基礎概念

簡單:介面在元件上,占用空間小

高效:能夠以10kbps的最大傳輸速率支援40個元件

多主控:任何能夠進行傳送和接收的裝置都可以成為主匯流排

2、協議簡介

匯流排訊號 : 

sda :序列資料線

scl  :序列時鐘

匯流排空閒狀態 :

sda :高電平

scl :高電平

起始位:scl為高電平期間    sda出現下降沿

終止位:scl為高電平期間 sda出現上公升沿

資料傳輸 :sda的資料在scl高電平期間被寫入從機。所以sda的資料變化要發生在scl低電平期間。

iic時鐘頻率:不高於400k

響應訊號(ack):處理器把資料發給外接iic裝置,如何知道iic裝置資料已經收到呢?就需要外接iic裝置回應乙個訊號給處理器。處理器發完8bit資料後就不再驅動匯流排了(sda引腳變輸入),而sda和sdl硬體設計時都有上拉電阻,所以這時候sda變成高電平。那麼在第8個資料位,如果外接iic裝置能收到訊號的話接著在第9個週期把sda拉低,那麼處理器檢測到sda拉低就能知道外接iic裝置資料已經收到。

用7bit表示從位址,那麼可以掛載的從裝置數是2的7次方128個。處理器想寫的話:先傳送起始位,再發乙個8bit資料:前7bit表示從位址,第8bit表示讀或者寫。0write是處理器往iic從裝置發,1read是iic從裝置往處理器發。第9個時鐘週期回覆響應訊號。

(以上摘自:

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