10. 以下關於latch和flip-flop特性描述正確的是:(acd)
a. latch與flip-flop都屬於時序邏輯
b. latch無時鐘輸入
c. flip-flop只會在時鐘觸發沿取樣當前輸入產出輸出
d. latch輸出可能產生毛刺
解析：組合邏輯電路的特點是輸出訊號只與當前時刻相關，與其它時刻的輸入狀態無關，五儲存電路，也沒有反饋電路。因此latch應該屬於時序電路。latch是電平敏感的儲存單元，資料儲存的動作取決於輸入時鐘或者使能訊號的電平值，因此latch可以有時鐘輸入，但是用的是時鐘的電平值。
每日一題 4 10 P1088 火星人
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