這次來設計乙個3線-8線解碼器：
##3線-8線解碼器的功能；
##如何用always語句、case語句進行邏輯功能的描述。
3線-8線解碼器功能：（1）實現邏輯函式； （2）實現儲存系統的位址解碼； （3）帶使能段的解碼器可用作資料分配器或脈衝分配器。
##解碼是編碼的逆過程，3線-8線解碼器可以將n位二進位制**可譯成2n種電路狀態。解碼器框圖如下所示。
always語句的相關解釋：
時序控制語句的相關解釋：
case語句：
case語句是乙個多路條件分支形式，其語法如下：
case(case_expr)
case_item_expr : procedural_statement
[default: procedural_statement]
endcase
case語句首先對條件表示式case_expr求值，然後依次對各分支項求值並進行比較，第乙個與條件表示式值相匹配的分支中的語句被執行。可以在1個分支中定義多個分支項；這些值不需要互斥。預設分支覆蓋所有沒有被分支表示式覆蓋的其他分支。
最後結束時千萬不要忘記『endcase』!!!
當使能端為0時，8位輸出訊號全為0；如果一位使能訊號為1,則輸出高電平有效的解碼訊號。該解碼器真值表如下所示。
verilog hdl**檔案：
測試集：
以上是簡單的關於verilog hdl對3線-8線解碼器的設計。
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