eda技術進行電路設計的大部分工作是在eda軟體平台上進行的。eda的設計流程主要包括設計輸入、設計處理、設計驗證、器件程式設計和硬體測試等5個步驟。
1.設計輸入
設計輸入有多種方式，主要包括文字輸入方式、圖形輸入方式和波形輸入方式，還支援文字輸入和圖形輸入兩者混合的方式。
文字輸入方式是採用硬體描述語言進行電路設計的方式，主要有verilog hdl、vhdl等，具有很強的邏輯功能表達能力，描述簡單，是目前進行電路設計最主要的設計方法。
圖形輸入方式是最直接的設計輸入形式。利用設計軟體提供的元件庫，將電路的設計以原理圖的方式輸入。這種輸入方式直觀，便於電路的觀察及修改，但是不適用於複雜電路的設計。
2.設計處理
設計處理是eda設計流程中重要的設計環節，主要對設計輸入的檔案進行邏輯化簡，綜合優化，最後產生程式設計檔案。此階段主要包括設計編譯與檢查、邏輯分割、邏輯優化、布局佈線等過程。
設計編譯與檢查是對輸入檔案進行語法檢查，例如，原理**件中是否有短路現象，文字檔案的輸入是否符合語法規範等。
邏輯分割是將設計分割成多個成便於識別的邏輯小塊形式對映到相應器件的邏輯單元中，分割可以自動實現，也可以由設計者控制完成。
邏輯優化主要包括面積優化和速度優化。面積優化的目標是使設計占用的邏輯資源最少，速度優化是使電路中訊號的傳輸時間最短。
布局佈線是指完成電路中各電路元件的分布及線路的連線。
3.設計驗證
設計驗證即時序**和功能**。通常情況下，先進行功能**，因此功能**又稱為前**，它直接對原理圖描述或其他描述形式的邏輯功能進行測試模擬，驗證其實現的功能是否滿足原設計的要求，**的過程不涉及任何具體形式的硬體特性，不經歷綜合和適配。在功能**已經完成，確認設計檔案表達的功能滿足要求後，再進行綜合適配和時序**。時序**是在選擇了具體器件並且完成布局佈線之後進行的時序關係**，因此又稱為時延**或後**。
4.器件程式設計
5.硬體測試
硬體測試是指將含有載入了設計的fpga或cpld的硬體系統進行統一測試，便於在真實的環境中檢驗設計效果。
了解FPGA的設計流程嗎，看完這篇文章你就懂了
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