8.pld/fpga io電平相容原則
l i/o單元：是晶元與外界電路的介面部分，需要完成不同電氣特性下對輸入/輸出訊號的驅動與匹配要求。
l i/o bank：fpga的io被劃分為若干個bank，每個bank都有vcco和vref。
l io標準：根據外部器件需求，選擇io標準。io標準由vcco或者/和vref確定，通過軟體配置。
l vcco：埠電壓，電平標準，同乙個vcco下可相容不同的io標準。
l vref：參考電壓，給部分輸入標準提供參考電壓。
故每個bank只能有乙個vcco，同乙個vcco下的標準可以不同。不同bank可支援不同的vcco。這就是電平相容。電平相容如下：
vcco
compatible standards
3.3v
pci,lvttl,sstl3 i,sstl3ii,ctt,agp,lvpecl,gtl,gtl+
2.5v
sstl2i,sstl2ii,lvcmos2,lvds,buslvds,gtl,gtl+
1.8v
lvcmos18,gtl,gtl+
1.5v
hstli,hstliii,hstliv,gtl,gtl+
*gtl和gtl+適用於所有電平，是因為開漏輸出和vcco無關。
*很多輸出標準和lvttl,lvcmos,pci的輸入標準需要vcco。
*一些輸入標準需要vref
io標準
電壓gtl+
1.0hstlclassi,hstl classii
0.75
hstlclassiii,hstlclassiv
0.9sstl2classi，sstl2class ii
1.25
sstl3classi，sstl3classii
1.5i/o standard
input(vref)
input(vcco)
output(vcco)
vtt
lvttl(2-24ma)
n/a3.3
3.3n/
lvcmos2
n/a2.5
2.5n/a
lvcmos18
n/a1.8
1.8n/a
pci(3v,33mhz/66mhz)
n/a3.3
3.3n/a
gtl0.8
n/a
n/a
1.2gtl+
1.0n/a
n/a
1.5hstl class i
0.75
n/a
1.50.75
hstl class iii
0.9n/a
1.51.5
hstl class iv
0.9n/a
1.51.5
sstl3 class i and ii
1.5n/a
1.51.5
sstl2 class i and ii
1.25
n/a
3.31.25
ctt1.5
n/a
2.51.5
agp1.32
n/a
3.3n/a
lvds,bus lvds
n/a
n/a
2.5n/a
lvpecl
n/a
n/a
3.3n/a
*vref是由其i/o訊號需要還是不需要vref來決定的
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