鬱悶了1天，為什麼不行呢，蒼天無眼，我該如何面對……
不就是想通過微控制器給個訊號嘛，使得verilog工程裡面的某些變數復位，使得mcu—fpga聯調更加的智慧型和諧，可是，可是……
為啥**行的，實際驗證就一直為0，一直就不行了呢？
鬱悶省略號……
請見下文：rst_n是fpga本身板載按鍵訊號，reg_clr是mcu給的訊號，但是為什麼不行呢？？曾經聽一位老師說過，系統聯調，雙時鐘衝突，使得資料缺失。那這是不是類似的問題呢：系統聯調，雙復位衝突，使得系統nc，是不是呢？？不知道，大概是的，至少這是乙個問題，發現了，未解決，and 待解決……難道雙系統衝突真的會造成這樣的後果嗎？need more time，此問題已經避免了，下次要是再讓我遇到了，我非宰了它不可！！！！！雙系統開機取消系統選擇畫面直接進入預設系統
我們右擊桌面上的 計算機 或 這台電腦 選擇 屬性 在 計算機屬性 中我們選擇 高階系統設定 在 高階系統設定 我們選擇 啟動和故障恢復 中我們點選 設定 這樣就可以進入 啟動和故障恢復 中。我們發現我們的 顯示作業系統列表的時間 我們被我們選中了。我們把前面的勾去掉就可以了。他的設定是控制我們開機...
雙系統安裝
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安裝雙系統
建立乙個自定義列表 如何建立乙個註腳 注釋也是必不可少的 katex數學公式 新的甘特圖功能，豐富你的文章 uml 圖表 flowchart流程圖 匯出與匯入 你好！這是你第一次使用markdown編輯器所展示的歡迎頁。如果你想學習如何使用markdown編輯器,可以仔細閱讀這篇文章，了解一下mar...