VHDL day1 程式結構ENTITY

entity 實體名 is
[generic(類屬表);]
[port(埠表);]
end entity 實體名

注：

1.實體名：功能元件的名字，用英文表示

2.方括號表示實際用的時候視情況而新增，用到就寫，用不到就可以省略 3.

generic 是類屬說明，是一種埠介面常數，定義的一般是

靜態資訊,不能在內部改變(但可以由外部來改變，或者利用

類屬對映語句來指定值)。它的用法如下

generic(常數名:資料型別[:設定值];
常數名:資料型別[:設定值];)

資料型別通常取integer(整數) 或者 time(時間，例如55ns)

例如：

generic(t_rise:time:=2ns;
t_fall:time:=1ns);

注:

4.port 的用法如下

port(埠名:埠模式  資料型別;
埠名:埠模式  資料型別);

埠模式有in(輸入端) out(輸出端) buffer(緩衝埠，本質上是輸出，但可以將輸出的值反饋回內部) inout(輸入輸出雙向端)

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