verilog coding錯誤型別
命名1.訊號_n一般表示低有效,
訊號定義
暫存器溢位 一定要寫default,以防跑飛
封裝成ip
1.新建乙個工程
2.屬性設定
3.synthesis 生成ngc.file
4.生成乙個只含埠訊號的頂層檔案
5.工程b中
同步復位和非同步復位 復位訊號起作用的時間是否與時鐘對齊
同步復位的好處在於他只在時鐘訊號沿觸發,進行系統復位,降低了亞穩態的出現概率,但他需要消耗更多的器件資源
採用非同步復位的埠無需額外增加器件資源的消耗,亞穩態
建議使用非同步復位的模組重構全域性的擬同步復位訊號
復位訊號大多數都是低電平有效,這是為了統一電路處理,使得上電過程和按鍵按下過程處理電路一樣,在沒上電時,每個管腳都認為是低電平。如此,上電自然可以復位一下。
系統的輸入輸出可以分為兩類:第一種是和特殊介面協議的晶元,如dsp,mps等,這些晶元的輸入輸出介面的時序是固定的。另一種介面是高速資料通道。
針對第一種固定時序的介面時序,其實就是有限狀態機設計。這種設計的簡單思想,就是按照外邊晶元的時序,設計我們晶元的介面。
fpga做序列的資料運算就比較合適,dsp處理器做一些需要控制流程以及序列操作的工作更為得心應手
系統的功能劃分不僅僅需要考量功能是不是合適,也要考慮介面的複雜度
程式語言不用操心資料儲存的管理,數字邏輯設計就要自己設計,可以儲存資料的結構有ram(資源大,複雜),fifo(資料處理完就不再用這些資料的時候),還有d觸發器組構成的buffer(資源有限,實現和讀取結構簡單 )。
FPGA 及數位電路基礎小知識(一)
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數位電路基礎草稿
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FPGA入門到精通系列1 數位電路基礎知識
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