I2S音訊匯流排學習(四)I2S介面設計

2021-08-13 10:55:46 字數 492 閱讀 8977

圖1 傳送端

隨著ws訊號的改變,匯出乙個wsp脈衝訊號,進入並行移位暫存器裝入data left或data right,從而輸出資料被啟用。序列資料在時鐘下降沿移出。序列資料的預設輸入是0,因此所有位於最低位(lsb)後的資料將被設定為0。

圖2 接收端

隨著第乙個ws訊號的改變,wsp在sck訊號的下降沿重設計數器。在「1 out of n」解碼器對計數器數值進行解碼後,第乙個序列的資料(msb)在sck時鐘訊號的上公升沿被存放進入b1,隨著計數器的增長,接下來的資料被依次存放進入b2到bn中。在下乙個ws訊號改變的時候,資料根據wsp脈衝的變化被存放進入左(聲道)鎖存器或者右(聲道)鎖存器,並且將b2一bn的資料清除以及計數器重設,如果有冗餘的資料則最低位之後的資料將被忽略。注意:解碼器和計數器(虛線內的部分)可以被乙個n位元移位暫存器所代替,如圖3所示。

當計數計滿時,即enn為高時,計算器en訊號變成低電平,使計數器停止計數,同時也使串並轉換模組停止接收資料。

圖3  接收端

I2S音訊匯流排學習(四)I2S介面設計

圖1 傳送端 隨著ws訊號的改變,匯出乙個wsp脈衝訊號,進入並行移位暫存器裝入data left或data right,從而輸出資料被啟用。序列資料在時鐘下降沿移出。序列資料的預設輸入是0,因此所有位於最低位 lsb 後的資料將被設定為0。圖2 接收端 隨著第乙個ws訊號的改變,wsp在sck訊號...

I2S音訊匯流排學習(二)I2S匯流排協議

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