問題描述：現在需要這樣乙個訊號，需要在硬體復位後得到一段低電平，用於作為程式的開始訊號，之後始終保持為高電平
需要寫乙個計時器
reg [6:0] cnt;
reg soft_rst;
always@(posedge clk or negedge rst)
begin
if(!rst)
cnt<=7』d0;
else
if(cnt<7』d70)
cnt<=cnt+1;
else
cnt<=cnt;
endalways@(posedge clk)
begin
if(!rst)
soft_rst<=1』b1;
else
if((cnt>7』d30)&&(cnt<7』d60))
soft_rst<=1』b0;
else
soft_rst<=1』b1;
end
這樣將得到乙個在cnt=31至60為低電平，其他為高電平，並在60後始終保持為高電平的訊號soft_rst。
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