typedef struct filters;
#define pi m_pi
#define ln(n) m_ln2
const double fs = 48000.0; //dsp的取樣頻率 48khz
filters filter; //定義乙個濾波
//公共變數計算
void common_variables(filters *p)
//void coefficients(filters *p)
void low_shelf(filters *p)
void high_shelf(filters *p)
/**
* 計算數字濾波器的頻率響應
* num 是數字濾波器的分子多項式係數
* den 是數字濾波器的分母多項式係數
* num_order 是分子多項式的階數
* den_order 是分母多項式的階數
* sign = 0 時,x_out 為頻率響應的實部, y_out 為頻率響應的虛部
* sign = 1 時,x_out 為頻率響應的模, y_out 為頻率響應的幅角
* sign = 2 時,x_out 為以 db 為單位的頻率響應, y_out 為頻率響應的幅角
* len 為,頻率響應的取樣點數
*/
void gain(double num, double den, int num_order, int den_order,
double x_out, double y_out, int len, int sign)
ar = 0.0;
ai = 0.0;
for(i = den_order; i > 0; i--)
br = br + num[0];
ar = ar + 1.0;
numr = ar * br + ai * bi;
numi = ar * bi - ai * br;
de = ar * ar + ai * ai;
x_out[k] = numr / de;
y_out[k] = numi / de;
switch(sign)
} } #define n 68
double den[3];
double num[3];
double x_out[n], y_out[n];
int main(void)
_nop(); }}
整數翻譯成英文
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有的時候,寫verilog 時,不太確定是否正確,會寫一段偽c 來進行驗證,比如 module sum input clk,input rst,output 15 0 cnt reg 15 0 data always posedge clk or negedge rst if rst data 16...