1、區域性變數定義（parameter）
宣告：
parameter xx = 8; （注意有等號，且後面有分號）
使用：xx
作用域：parameter 作用於宣告的那個檔案。
另外parameter可以用作例化時的引數傳遞。具體方法參見《verilog例化時的引數傳遞》一文
2.全域性變數定義（`define ）（注意撇號來自鍵盤左上方破浪線那個鍵，不是單引號）
宣告：
`define xx 8 （無等號，且不用分號）
使用：`xx（使用該斌兩時必須在變數前加撇號）
作用域：`define 從編譯器讀到這條指令開始到編譯結束都有效，或者遇到`undef命令使之失效。
3.如何讓變數在整個專案都有效
如果想讓parameter或`define作用於整個專案，可以將如下宣告寫於單獨檔案，並用`include讓每個檔案都包含宣告檔案：
`ifndef xx
`define xx yy // or parameter xx = yy;
`endif
`define也可以寫在編譯器最先編譯的檔案頂部。通常編譯器都可以定義編譯順序，或者從最底層模組開始編譯。因此寫在最底層就可以了。
全域性變數和區域性變數
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全域性變數和區域性變數
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全域性變數和區域性變數
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