來自 arm cortex-m3處理器體系結構.ppt
定位：
概況：
cortex-m3核心：
核心流水線分3個階段：
取指、解碼和執行。當遇到
分支指令時，
解碼階段也包含**的指令取指，這提高了執行的速度。處理器在解碼階段期間自行對分支目的地指令進行取指。在稍後的執行過程中，處理完分支指令後便知道下一條要執行的指令。如果分支不跳轉，那麼緊跟著的下一條指令隨時可供使用。如果分支跳轉，那麼在跳轉的同時分支指令可供使用，空閒時間限制為乙個週期。
cortex-m3 處理器是乙個 32 位處理器，帶有 32 位寬的資料路徑，暫存器庫和儲存器介面。其中有 13 個通用暫存器，兩個堆疊指標，乙個鏈結暫存器，乙個程式計數器和一系列包含程式設計狀態暫存器的特殊暫存器。
cortex-m3 處理器支援兩種工作模式（執行緒（thread）和處理器（handler））和兩個等級的訪問形式（有特權或無特權），在不犧牲應用程式安全的前提下實現了對複雜的開放式系統的執行。
效能引數：
cortex-m3處理器指令集thumb-2：
好處：注：cortex-m3不支援arm指令集。
cortex-m 技術之cmsis：
cortex-m 技術之nvic：
其他，略過......
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cortex-m3處理器體系結構.ppt
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