1、 在sd.c的檔案中定義的host_max_mclk是怎麼定義的？197000000對應的clk為多少hz？具體的換算公式是怎麼樣的？修改這個clk會影響哪些效能？
è#define host_max_mclk (197000000)
è197mhz
在定義最快跑多少
假設max clk
在50mhz
但如果想將
clk設定在
70mhz
就跑不到
70mhz
另外確實是透過
msdc_set_mclk
來設定要跑的速度
時鐘源的
clk是
208m
2、在struct msdc_hw msdc3_hw結構體中定義的flags的各個標誌是什麼意思？msdc_ext_sdio_irq ，msdc_highspeed，msdc_tabdrv，msdc_internal_clk，分別對應什麼？
èmsdc_ext_sdio_irq: sdio
使用external irq
msdc_internal_clk:
這個clock
指的是msdc ip
用來latch data
的clock;
msdc_highspeed:
能夠跑到
50mhz
msdc_tabdrv:
是否可以調整
cmd data clk driving current
的開關可以參考
msdc_init_hw
這個function
3、看字面意思msdc_internal_clk為使用的內部clk，所謂的內部clk和外部clk是什麼區分？分別影響到哪些地方？內部clk和外部的clk的不同是否會影響wifi效能？
è如果沒新增
msdc_internal_clk flag
就是使用
feedback clk (
打出去再回來的
clock)
無論是使用
internel
還是feedback clk
基本上clock rate
相同的話
並不會影響
wifi
效能btw,
在mt6589
上default
都是internal clk
了clk resource
4、在struct msdc_hw msdc3_hw結構體中driverin current中有0~4，分別對應的驅動所表示的電流是多少ma？
5、在struct msdc_hw msdc3_hw結構體中cmd_edge,data_edge現在的修改都是實驗，是否有辦法確認是否需要使用rising還是falling？
è是需要實驗，因為每家客戶的
pcb屬性不一樣。
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