uvm_sequence_item相當於乙個pkt，seq用於隨機化該pkt等。sqr用於傳送。
另外uvm_do不僅可以傳送item，也可以傳送seq。seq支援巢狀。
start_phase常常存在seq的task body中，它是在正確得到sqr後，指向sqr某乙個phase。而seq不是comp，它沒有phase。
一般在raise和drop對於seq時候，可以建立基類base_seq extends uvm_seq，然後在uvm_seq中設計pre_start、post_start。
後面的seq繼承該base_seq後就不用寫了。注意base_seq中不僅需要判斷一下start_phase不為null，也需要判斷get_parent_sequence()為null，否則中間的繼承類也raise就重複了。
seq建立req，
seq執行start_item-> sqr.wait_for_grant;sqr.begin_tr(req)
seq中的req執行randomize，
seq執行finish_item->sqr.send_request, sqr.wait_for_item_done, sqr.end_tr(req)
其中的sqr.send_request,執行到drv的forever語句，獲取req，傳送給dut，執行item_done，給sqr.wait_for_item_done
因為每次例項化，所以不能用uvm_do了，需要手動實現。
首先建立req，然後在迴圈中，注意重新生成乙個新的req_copy用於開闢新空間，然後傳送。
seq亂序埠
亂序drv
元件資訊查詢
查詢層次關係
都可操作全域性資源池，但是前者用於全域性配置後者用於對comp配置。
不看最後一行的read_by_type
dump所有的uvm_resource_db操作可以用uvm_resources.dump_get_records()函式
uvm_resources.find_unused_resources查詢沒有使用的資源。
執行simv時候，使用-l simv.log可以將log寫入檔案。
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