verilog/vhdl(以下簡稱verilog，手動眼斜)
原因如下：
1，跳過作業系統，對底層電路進行程式設計；
2，為什麼它是程式語言。因為它可以在現場可程式設計邏輯陣列上執行，沒人規定一定要在cpu上跑的才叫程式語言吧。
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說說verilog為什麼快：
基於馮諾依曼結構的程式語言需要先編譯成機器語言之後，run起來需要流式取指解碼然後執行，指令之間也是流式進行。而且一條指令可能需要幾個或者幾十個cpu時鐘週期。哪怕是最貼近底層的組合語言，也沒辦法避免單指令多週期的時間剛需，也無法避免這些時鐘週期還可以流水線疊加。
而verilog如果設計得好，在不太care硬體資源的前提下，任何指令甚至具有一定功能的程式，都可以在乙個時鐘週期內完成。（可以理解為電路具有無限並行能力）
可以舉個例子，比如寫個if-else分支。在cpu上會用跳轉的方式來完成，比較判斷跳轉，說三個時鐘週期算少。而在verilog上呢，直接編譯成乙個mux，乙個週期搞定。在多分支的情況下，多個mux疊加，verilog的優勢會越來越大。
verilog的缺點也是很明顯，開發起來比彙編都痛苦(別問我是怎麼知道的)。很多軟體工程師不了解verilog也是有原因的。舉個例子，都知道很多演算法(挖礦，nn等)在gpu上跑得比cpu快很多，原因之一就是gpu上很多矩陣運算都用專用電路加速了(這部分專用計算電路就是由硬體描述語言verilog之類完成後再固化的)。所以，效能最強的程式語言，我投verilog一票。
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