《計算機儲存與外設》 2主儲存器

2022-04-02 03:23:02 字數 1129 閱讀 6669

計算機應該由玻璃構成,因為它到處都是瓶頸。

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簡而言之,主儲存器儲存一些資料直到cache需要這些資料或者關閉了計算機電源。

雖然儲存器的速度逐年提公升,但是現代處理器的提公升速度更快,這導致儲存器系統成為現代處理器的一大瓶頸。

一些常見名詞的介紹:

儲存器引數

需要注意的注意是64位機,32位機主要是由cpu暫存器位數決定的。

儲存器的主要時間引數是其讀訪問時間,寫訪問時間和週期時間,週期時間是兩個連續的儲存器訪問之間的最小間隔時間。

資料寫入位元時,將要寫的一位資料及其取反值分別放在data和!data訊號線上發出讀/寫訊號。反向器節點a和b被修改為所期望的值,當讀/寫訊號為低電平時保持寫入的資料。當進行讀操作時,首先發出讀/寫訊號,使反向器的輸出與資料訊號線連線,然後讀取a節點的電平訊號即可。

乙個反相器需要2個串聯的電晶體實現。所以每個靜態位元需要6(2+2+1+1)個電晶體實現。而動態儲存位元只需要1個電晶體即可。但是靜態儲存器訪問速度快於動態儲存器。

下面為sram的讀週期時序圖

sram的寫週期時序圖

寫週期往往比讀週期複雜。

動態隨機訪問儲存器(dram)工作原理很簡單。資料以儲存在電晶體之中的靜電荷形式儲存。材料不帶電時,電子數等於質子數,而如果電子過多,帶負電,電子過少,帶正電。在微小電容上有極性還是沒有極性可以儲存乙個位元。

《計算機儲存與外設》 導讀

目 錄 第1章 cache儲存器和虛擬儲存器 1.1 cache儲存器概述 1.1.1 cache儲存器的結構 1.2 cache儲存器的效能 1.3 cache的組織 1.3.1 全相聯對映cache 1.3.2 直接對映cache 1.3.3 組相聯cache 1.3.4 偽相聯 victim ...

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