後端P R(place與route)要具備的能力

2021-10-24 06:39:06 字數 512 閱讀 6281

數字後端布局佈線(p&r,place-and-route)是netlist-to-gdsii的過程,是決定能否流片的首要前提,也直接關係到晶元設計時序收斂、ppa、可製造性與良品率等。

p&r對工具的依賴性較強,工具操作相對複雜。作為數字後端設計工程師,不清楚p&r全流程、對eda 工具操作不熟練、沒有掌握各流程環節的分析與優化技巧,則無法高效正確完成後端設計,甚至會導致流片節點的延期與流片的失敗。

隨著積體電路規模不斷加大,市場對數字後端工程師的需求旺盛。

後端工程師要具備的能力:

布局佈線所需的工藝檔案與庫、floorplan、cts、place、route、mcmm等全流程和技術知識,熟練使用eda工具ic compiler ii(iccii)進行布局佈線各階段的設定與優化,掌握congestion改善、時鐘樹分析、全域性和布局skew優化、timing violation fixing、功能和時序eco等技巧,掌握drc、metal filling等物理驗證與可製造性等知識。

詳情如下:

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