非常精妙的主副電源自動切換電路，並且「零」壓降
今天這篇文章，是在白雲機場寫的，我都佩服我自己竟然這麼勤奮，沒辦法，後台小夥伴一直催更文章，我只能犧牲掉一切娛樂時間陪你們了。
看到這裡，如果這篇文章你還不**朋友圈，那真是不夠意思了，感謝大家支援晶元之家，你們的**點讚就是我的最佳動力！
在國外看到乙個電路，也是寫主副電源自動切換的電路，設計的非常巧妙，剛看到標題時，我就想我不是已經分享過類似文章了麼，但是還是點進去看了下。
之前的電路：usb外接電源與鋰電池自動切換電路設計，你get到精髓了嗎？
上面電路設計也挺不錯的，如果vcc端需要的電壓不一定要求等於vusb，那麼這個電路是可以的，那麼問題來了，如果主副輸入電壓相等，同時要求輸出也是同樣的電壓，不能有太大的壓降，怎麼設計？
上面的電路肯定不能滿足了，因為d1的壓降最小也是0.3v，我們看下面的電路。
這個電路咋一看複雜很多，其實很簡單，巧妙的利用了mos管導通的時候低rds的特性，相比二極體的方式，在成本控制較低的情況下，極大的提高了效率。
本電路實現了，當vin1 = 3.3v時，不管vin2有沒有電壓，都由vin1通過q3輸出電壓，當vin1斷開的時候，由vin通過q2輸出電壓。因為選用mos管的rds非常小，產生的壓降差不多為數十mv，所以vout基本等於vin。
原理分析
1、如果vin1 = 3.3v，nmos q1導通，之後拉低了pmos q3的柵極，然後q1也開始導通，此時，q2的柵極跟源極之間的電壓為q3的導通壓降，該電壓差不多為幾十mv，因此q2關閉，外部電源vin2斷開，vout由vin1供電，vout = 3.3v。此時整個電路的靜態功耗i1+i2 = 20ua。
2、現在，vin1斷開了，q1截止，q2的柵極有r1的下拉，所以q2導通，q3的柵極通過r2上拉，所以q3也截止，整個電路，q1跟q3截止，vout由vin2供電，vout = 3.3v。此時上面電路i1跟i2的靜態功耗不存在。
分析完畢。當存在主電源時，電路的靜態功耗為20ua，否則，幾乎為零。所以電池適合在外部電源供電。
mosfet q1、q2跟q3應該選擇具有低壓柵極和非常低的導通電阻特性。例如：q2 = q3 = pmn50xp ，在v gs = 3.3v時r dson為60mω。電晶體t3可以是流2n7002，僅供參考，實際根據不同的情況選擇合適的mosfet。
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