首先介紹下as、ps、jtag三種模式的區別。
as模式:
燒到fpga的配置晶元裡儲存的，fpga器件每次上電時，作為控制器從配置器件epcs主動發出讀取資料訊號，從而把epcs的資料讀入fpga中，實現對fpga的程式設計，該方法適用於不需要經常公升級的場合；
ps模式：jtag：
直接燒到fpga裡面的，由於是sram，斷電後要重燒，適用於除錯；
jtag介面是乙個業界標準介面，主要用於晶元測試等功能。
altera fpga基本上都可以支援jtag命令來配置fpga的方式，而且jtag配置方式比其他任何方式優先順序都高。jtag介面有4個必需的訊號tdi, tdo, tms和tck以及1個可選訊號trst構成，其中：
. tdi，用於測試資料的輸入；
. tdo，用於測試資料的輸出；
. tms，模式控制管腳，決定jtag電路內部的tap狀態機的跳變；
. tck，測試時鐘，其他訊號線都必須與之同步；
. trst，可選，如果jtag電路不用，可以講其連到gnd。
fpga和10針插座連線圖：
由fpga器件引導配置操作過程，它控制著外部儲存器和初始化過程，epcs系列.如epcs1,epcs4配置器件專供as模式，目前只支援 stratix ii 和cyclone系列。使用altera序列配置器件來完成。cyclone器件處於主動地位，配置器件處於從屬地位。配置資料通過data0引腳送入 fpga。配置資料被同步在dclk輸入上，1個時鐘週期傳送1位資料。
as配置器件是一種非易失性、基於flash儲存器的儲存器，使用者可以使用altera的byteblaster ii載入電纜、altera的「altera programming unit」或者第三方的程式設計器來對配置晶元進行程式設計。它與fpga的介面為以下簡單的4個訊號線：
. 序列時鐘輸入（dclk）：是在配置模式下fpga內部的振盪器（oscillator）產生的，在配置完成後，該振盪器將被關掉。工作時鐘在20mhz左右，而fast as方式下（stratix ii和cyclone ii支援該種配置方式），dclk時鐘工作在40mhz左右，在altera的主動序列配置晶元中，只有epcs16和epcs64的dclk可以支援到40mhz，epcs1和epcs4只能支援20mhz。
. as控制訊號輸入（asdi）；
. 片選訊號（ncs）；
. 序列資料輸出（data）。
fpga和串列埠配置晶元連線圖：
fpga、串列埠配置晶元和10針插座連線圖1：
fpga、串列埠配置晶元和10針插座連線圖2：
與fpga的訊號介面:
. dclk（配置時鐘）；
. data0（配置資料）；
. nconfig（配置命令）；
. nstatus（狀態訊號）；
. conf_done（配置完成指示）
通過serial flash loader design將jtag inte***ce和as inte***ce聯絡起來。詳見c3手冊「programming serial configuration devices in-system using the jtag inte***ce」部分。當然，也可以將as和jtag都保留，詳見「combining jtag and active serial configuration schemes」部分。
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