目 錄
課程設計要求
數字鐘的功能要求
數字鐘電路系統的組成方框圖
單元電路設計
整體電路
第一章 緒論
1.1 對設計課題進行簡要闡述
利用按鍵,數碼管和蜂鳴器實現乙個簡單的數字鬧鐘。數碼管正確顯示時、分、
秒。可以設定當前時間。具有整點報時功能。
1.2 設計任務及其具體要求
精確計時,按鍵調時,整點報時,24時歸零
第二章 總體方案設計
2.1 原理闡述
主電路系統由秒訊號發生器、「時、分、秒」計數器、解碼器及顯示器、校時電路、整點報時電路組成。秒訊號產生器是整個系統的時基訊號,它直接決定計時系統的精度,將標準秒訊號送入「秒計數器」,「秒計數器」採用60進製計數器,每累計60秒發出乙個「分脈衝」訊號,該訊號將作為「分計數器」的時鐘脈衝。「分計數器」也採用60進製計數器,每累計60分鐘,發出乙個「時脈衝」訊號,該訊號將被送到「時計數器」。「時計數器」採用24進製計時器,可實現對一天24小時的累計。解碼顯示電路將「時」、「分」、「秒」計數器的輸出狀態用七段顯示解碼器解碼,通過七段顯示器顯示出來。整點報時電路時根據計時系統的輸出狀態產生一脈衝訊號,然後去觸發一音訊發生器實現報時。校時電路時用來對「時」、「分」、「秒」顯示數字進行校對調整。
2.2 總體設計方案方框圖
第三章 電路**設計
3.1 主要的硬體電路設計
1:電子計時模組;
本套計時採用了74ls161的非同步清零與同步置數的功能,將其秒個位設計成10清零,秒時位做成6清零,分部分同理,小時部分個位為10進製,十位為2進製,在滿足24時整體清零。
2:按鍵調整模組採用在每個顯示器的晶元clk與vcc加乙個按鍵,按下按鍵時則給乙個高電平加一。
1.整點報時電路
在時間到達59分時在51秒53秒55秒分別短暫的蜂鳴器響,然後57秒到59秒出現長鳴
具體原理如下:
二進位制 十進位制
0000 0
0001 1
0010 2
0011 3
0100 4
0101 5
0110 6
0111 7
1000 8
1001 9
出現整點報時,
在59分時,所以需要同時滿足分的十位在101(二進位制)5,個位1001(二進位制)9時才行,通過兩個與門分別接上個位和十位的二進位制為1的埠.
在50秒後開始,二進位制下最低位會不斷出現01變化,直接接上就可以達到短暫的鳴笛聲,長鳴需要在第四位為1時出現長鳴,需要將第一位或上第四位
3.2 元器件清單
1.7seg-bcd
2.and_3
3.and_2
4.or_2
5.and_4
6.buzzer
7.74161
8.switch
9.botton
3.3 硬體電路**設計
第四章 系統執行與除錯
4.1 **步驟
**實現1hz的clk時鐘訊號輸入:
當**開始時,由counter timer顯示出1即成功達到目的.
**實現60進製:
在秒,分時使用的是60進製,當個位為10時向十位進一,整體到60時實現清零.
**實現24進製:
在顯示時時.一天為24小時,需要在24時清零.
**實現可調時,分,秒:
在按下**按鍵後,再分別測試時分秒的調節按鍵是否可以實現對時分秒的調節.
4.2 **結果
通過**步驟,以上的功能全能實現.
第五章 總結
5.1 遇到的問題
在分秒為60時清零,這需要在110(二進位制)時清零,如果將二三位相與取非會出現競爭與冒險
即011到100時二位和第三位同時變化
開始是後面重新接線就不會出現問題了
蜂鳴器器最開始時不能用,因為預設蜂鳴器為12v的,但是整個電路為5v的,所以需要調節蜂鳴器的屬性為5v.
蜂鳴器的與門實現了高電平,卻不能鳴響.
5.2解決辦法
當出現競爭與冒險,即兩輸入的與非門出現兩出入同時變化時,這是可以選擇bcd編碼,或者三輸入的與非門再接上一位即可.
蜂鳴器的問題,認識到在proteus裡的零件需要了解其真實的屬性.
在proteus裡面換了乙個與門就ok了.
5.3 存在的不足
未對時鐘設計可調鬧鐘功能,只能實現整點報時功能.
在設計按鍵可調時分秒時,並未採取更好的方案,而是直接將vcc接入到了clk端,這樣在實際的電路中可能出現燒晶元的可能.
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