一、預習報告：
實驗目的：
1．掌握常用 msi 的邏輯功能。
2．學會用 msi 設計組合邏輯電路。
實驗原理：二進位制解碼器能把輸入變數的所有狀態都翻譯出來送到輸出端,它的每乙個輸出訊號都對應一種輸入**狀態,也就是輸入變數的乙個最小項。因此從實現組合邏輯函式的角度看，二進位制解碼器的輸出端提供了其輸入變數的全部最小項。那麼，利用二進位制解碼器和與非門可以實現任何組合邏輯函式，特別是有多個輸出的組合邏輯電路。
資料選擇器又叫「多路開關」，資料選擇器在位址碼（或叫選擇控制）電位的控制下，從幾個資料輸入中選擇乙個並將其送到乙個公共的輸出端。其輸出訊號邏輯表示式具有標準與或表示式的形式，提供了位址變數的全部最小項。而任何組合邏輯函式都是由它的最小項構成的，所以理論上，用資料選擇器可以實現任何組合邏輯函式。
實驗裝置：
1．計算機 一台
2．數位電路實驗箱 一台
3．基本閘電路及解碼器74ls138、選擇器74ls 153或解碼器74ls 154。
實驗步驟和**實驗資料：
1．三變數表決電路。
要求：多數表決電路按少數服從多數的原則執行表決，如果贊成用高電平表示，輸出中表決通過也用高電平表示，當3個輸入變數中有兩個或兩個以上取值為1時，輸出為1，由此可列出函式真值表，並寫出邏輯表示式。
真值表：
邏輯表示式：
2．兩個兩位二進位制數比較器兩個二位二進位制數比較器要實現對輸入的兩個二進位制數a1a0、b1b0進行比較的邏輯功能，當a>b時,f1=1;當a=b時,f2=1;當a
真值表：
邏輯表示式：
二、實驗內容
**電路和波形圖：
1、三變數表決電路。
2、兩個兩位二進位制數比較器。
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