spi序列同步時鐘可以設定為不同的極性（clock polarity ，cpol）與相位（clock phase ，cpha）。
時鐘的極性（cpol）用來決定在匯流排空閒時，同步時鐘（sck）訊號線上的電位是高電平還是低電平。當時鐘極性為0時（cpol=0），sck訊號線在空閒時為低電平；當時鐘極性為1時（cpol=1），sck訊號線在空閒時為高電平；
時鐘的相位（cpha）用來決定何時進行訊號取樣。
當時鐘相位為1時（cpha=1），在sck訊號線的第二個跳變沿進行取樣；這裡的跳變沿究竟是上公升沿還是下降沿？取決於時鐘的極性。當時鐘極性為0時，取下降沿；當時鐘極性為1時，取上公升沿；
如果 cpol=0，序列同步時鐘的空閒狀態為低電平；
如果cpol=1，序列同步時鐘的空閒狀態為高電平。時鐘相位（cpha）能夠配置用於選擇兩種不同的傳輸協議之一進行資料傳輸。
如果cpha=0，在序列同步時鐘的第乙個跳變沿（上公升或下降）資料被取樣；
如果cpha=1，在序列同步時鐘的第二個跳變沿（上公升或下降）資料被取樣。spi主模組和與之通訊的外裝置時鐘相位和極性應該一致。
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