Jlink介面的Jtag和SWD介面定義

2021-08-19 21:57:40 字數 866 閱讀 4588

原址

jlink**器介面

**器埠

連線目標板

備註1. vcc

mcu電源vcc

vcc2. vcc

mcu電源vcc

vcc3. trst

trst

test reset/ pin

4. gnd

gnd或懸空

5. tdi

tditest data in pin

6. gnd

gnd或懸空

7. tms, swio

tms, swio

jtag:test mode state pin ; swd: data i/o pin

8. gnd

gnd或懸空

9. tclk, swclk

tms, swclk

jtag: test clock pin ; swd: clock pin

10. gnd

gnd或懸空

11. rtck

rtck

12. gnd

gnd或懸空

13. tdo

tdotest data out pin

14. gnd

gnd或懸空

15. reset

reset

rstin pin

16. gnd

gnd或懸空

17. nc

nc18. gnd

gnd或懸空

19. nc

nc20. gnd

gnd或懸空

JTAG協議及介面的簡要了解

jtag joint test action group,聯合測試工作組 是一種國際標準測試協議 ieee 1149.1相容 主要用於晶元內部測試。現在多數的高階器件都支援jtag協議,如dsp fpga器件等。標準的jtag介面是4線 tms tck tdi tdo,分別為模式選擇 時鐘 資料輸入...

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