乙個記憶體包括乙個具有記憶功能的儲存矩陣（該矩陣是由m*n個儲存晶元構成），解碼驅動電路，以及讀寫電路構成。
解碼電路負責把位址匯流排送來的位址訊號翻譯成對對應儲存單元選擇的訊號，該訊號在讀寫電路的配合下完成對被選中單元的讀寫。
位址線的位數一般就是cpu的位數，說明位址線共有多少根，比如位址線有32位，那該位址線將能尋到2^32個儲存單元，注意是儲存單元，不是位，儲存單元的大小與資料線的根數是一致的，比如資料線是8位，那麼32位位址線與8位資料線的組合將支援4g位元組的記憶體。
位址解碼單元的工作原理有兩種：線選法與重合法。線選法時一般是位元組定址，比如8位資料線傳來00000001，那麼1號儲存單元的所有位被選中，該方法只適合用於小記憶體的情況。重合法的原理就是類似通過x,y來定位乙個矩陣單元，比如x方向位址線有32根，y方向位址線有32根。（0,0）將選中0行0列那個位。
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