arm中的pll，mpll，upll，fclk，hclk，pclk的作用概述 2014-08-19 11:15:19
分類： 嵌入式
前言：
不同公司，不同等級的arm架構也是有許多共同的地方，因此以最為廣泛使用的2440為例項講解。
一，pll
s3c2440 cpu主頻可達400mhz，開發板上的外接晶振為12m，通過時鐘控制邏輯的pll（phase locked loop，鎖相環電路）來倍頻這個系統時鐘。2440有兩個pll（phase locked loop）乙個是mpll，乙個是upll。upll專用於usb裝置，常用頻率為48mhz和96mhz。mpll用於cpu及其他外圍器件，用於產生fclk， hclk， pclk三種頻率，上電時，pll並沒有被啟動，fclk=fin=12mhz，若要提高系統時鐘，需要軟體來啟動pll。
1，fclk是cpu提供的時鐘訊號。
2，hclk是為ahb匯流排提供的時鐘訊號， advanced high-performance bus，主要用於高速外設，比如記憶體控制器，中斷控制器，lcd控制器， dma 等。
3，pclk是為apb匯流排提供的時鐘訊號，advanced peripherals bus，主要用於低速外設，比如看門狗，uart控制器， iis, i2c， sdi/mmc, gpio，rtc and spi等。
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