1.什麼是
dsp中的「內部上拉」和「內部下拉」？
dsp中介紹引腳時，註明pu，
pd說是「內部上拉」和「內部下拉」，
就是說內部已經配置了接電源的
上拉電阻或是接地的下拉電阻。這樣，當作
為輸入埠連線oc或
coms
晶元或浮空時。訊號線平
是確定的高/低電
平。而不是不確定的浮地電平。內部上拉，相當於輸入和電源之間接
了乙個幾十k的
電阻；下拉，相當於用電阻和地相連。
2.vcc，vdd，vss是什麼？
在電子電路中，vcc是電路的供電電壓，c = circuit，表示電路的意思；
vdd是晶元的工作電壓，d = device，表示器件的意思；
vss是接地或是負極，s = series，表示公共連線的意思。
3.時鐘週期、指令週期、機器週期、匯流排週期都是什麼東東？
時鐘週期：也稱為振盪週期，定義為時鐘脈衝的倒數（時鐘週期就是微控制器外接晶振的倒數，例如
12m的晶振，它的時鐘週期就是1/12us），是計算機中的最基本的、最小的時間單位。在乙個時鐘週期
內，cpu僅完成乙個最基本的動作。時鐘脈衝是計算機的基本工作脈衝，控制著計算機的工作節奏。時
鐘頻率越高，工作速度就越快。
指令週期：執行一條指令所需要的時間，一般由若干個機器週期組成。指令不同，所需的機器週期
也不同。
機器週期：計算機中，常把一條指令的執行過程劃分為若干個階段，每乙個階段完成一項工作。每
一項工作稱為乙個基本操作，完成乙個基本操作所需要的時間稱為機器週期。
匯流排週期：微處理器是在時鐘訊號clk控制下按節拍工作的。8086/8088系統的時鐘頻率為
4.77mhz，每個時鐘週期約為200ns。
由於存貯器和i/o埠是掛接在匯流排上的，cpu對存貯器和i/o介面
的訪問，是通過匯流排實現的。通常把
cpu通過匯流排對微處理器外部（存貯器或 i/o介面）進行一次訪問
所需時間稱為乙個匯流排週期。乙個總
線週期一般包含4個時鐘週期，這4個時鐘週期分別稱4個狀態即t1
狀態、t2狀態、t3狀態和 t4狀態。
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