為了簡化與ram之間的通訊，快取記憶體控制器是針對資料塊，而不是位元組進行操作的。從程式設計的角度講，快取記憶體其實就是一組稱之為快取行(cache line)的固定大小的資料塊，其大小是以突發讀或者突發寫週期的大小為基礎的。
現代處理器有專門的功能單元來執行載入和儲存操作。載入單元每個時鐘週期只有啟動一條載入操作；與載入操作一樣，在大多數情況下，儲存操作能夠在完整流水線化的模式中工作，每個週期開始一條新的儲存。
ps.謝謝cgl_lgs
的提醒，共享記憶體的平行計算，有可能會出現＂偽共享＂問題．比如，兩個處理器各要訪問乙個word，這兩個word卻存在於同乙個cache line大小的區域裡，這時，從應用邏輯層面說，這兩個處理器並沒有共享記憶體，因為他們訪問的是不同的內容（不同的word）。但是因為cache line的存在和限制，這兩個cpu要訪問這兩個不同的word時，卻一定要訪問同乙個cache line塊，產生了事實上的「共享」。顯然，由於cache line大小限制帶來的這種「偽共享」是我們不想要的，會浪費系統資源。
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快取行對齊
快取記憶體控制器是針對資料塊，而不是位元組進行操作的。從程式設計的角度講，快取記憶體其實就是一組稱之為快取行 cache line 的固定大小的資料塊，其大小是以突發讀或者突發寫週期的大小 為基礎的。快取基本上來說就是把後面的資料載入到離cpu自己進的地方，對於cpu來說，它是不會乙個位元組乙個位元...
CPU快取記憶體行
cpu 為了更快的執行 於是當從記憶體中讀取資料時，並不是唯讀自己想要的部分。而是讀取足夠的位元組來填入快取記憶體行。根據不同的 cpu，快取記憶體行大小不同。如 x86是 32bytes 而alpha 是64bytes 並且始終在第 32個位元組或第 64個位元組處對齊。這樣，當 cpu訪問相鄰的...